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DRAM Read Timing:
Description : La plupart des accès à la mémoire principale sont actuellement transmis par à coup (mode Burst). Pour le cache, il n'est pas intéressant de transmettre seulement un mot DWord/Word/Byte à la fois, mais plutôt 4 ou 8 mots(DWord) consécutifs par appel. C'est beaucoup plus rapide que de transmettre chaque octet un par un au cache ou au Processeur. Une lecture est faite (en quelques mots) en donnant à la mémoire la première adresse en premier et les autres DWord seont lus dans une colonne, sans dire à la mémoire l'adresse de chaque bloc d'information. De plus ça économise beaucoup de temps, en cycles d'horloge, ça donne quelque chose comme x-y-y-y pour une phase normale ou x-y-y-y-z-y-y-y pour une phase appelée back-to-back. La Cache Pipeline Burst RAM cela pourrait donner 3-1-1-1 ou 3-1-1-1-1-1-1-1. C'est le nombre de cycles d'horloge qu'a besoin le processeur pour lire son cache "Pipeline Burst". Pour la mémoire principale ce n'est pas une valeur fixée comme le cache "Pipeline Burst", vous pouvez déterminer les x,y voire les z du fait des différences de type et de vitesse des mémoires DRAM.
Après votre ordinateur va beaucoup plus vite quand les valeurs x,y,z sont au plus bas, parce que cela nécessite moins de cycles d'horloge au processeur pour lire les blocs d'informations à exécuter. Le DRAM Read Timing est un peu le 'x'. Donc vous devriez choisir quelque chose comme x222 et x333 pour l'EDO et x333 et x444 pour la FPM RAM. Vous devrez aussi essayer de le combiner avec chaque autre, comme x222/x333 et x333/x444, ou les plus grandes valeurs sont pour la FPM, les plus basses pour l'EDO RAM.